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【2h】

Scalable VLSI Architectures For Full-Search Block Matching Algorithms

机译：用于全搜索块匹配算法的可扩展VLsI架构

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Yuan-hau Yeh; Chen-yi Lee;
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年度 2013
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1. Cost-effective VLSI architectures and buffer size optimization for full-search block matching algorithms [J] . Yuan-Hau Yeh, Chen-Yi Lee IEEE transactions on very large scale integration (VLSI) systems . 1999,第3期

机译：具有成本效益的VLSI架构和针对全搜索块匹配算法的缓冲区大小优化
2. Parameterizable VLSI architectures for the full-search block-matching algorithm [J] . de Vos L., Stegherr M. IEEE Transactions on Circuits and Systems . 1989,第10期

机译：用于全搜索块匹配算法的可参数化VLSI架构
3. A low-power VLSI architecture for full-search block-matching motionestimation [J] . Do V.L., Yun K.Y. IEEE Transactions on Circuits and Systems for Video Technology . 1998,第4期

机译：一种用于全搜索块匹配运动估计的低功耗VLSI架构
4. Scalable VLSI architectures for full-search block matching algorithms [C] . Yuan-Hau Yeh, Chen-Yi Lee Image Processing, 1996. Proceedings., International Conference on . 1996

机译：用于全搜索块匹配算法的可扩展VLSI架构
5. Low-power and high-speed algorithms and VLSI architectures for error control coding and adaptive video scaling. [D] . Raghupathy, Arun. 1998

机译：用于错误控制编码和自适应视频缩放的低功耗，高速算法和VLSI架构。
6. Compute-unified device architecture implementation of a block-matching algorithm for multiple graphical processing unit cards [O] . Francesc Massanes, Marie Cadennes, Jovan G. Brankov -1

机译：计算的统一设备架构实现块匹配算法的多个图形处理单元卡
7. c ○ 1997 Kluwer Academic Publishers. Manufactured in The Netherlands. An Efficient VLSI Architecture for Full-Search Block Matching Algorithms ∗ [O] . Chen-yi Lee, Mei-cheng Lu 1994

机译：c○1997年Kluwer学术出版社。在荷兰制造。用于全搜索块匹配算法的高效VLSI架构
8. Radar Signal Processing Architectures and Algorithms in Digital VLSI (Very Large Scale Integration) [R] . Roberts, J. B. G., Darby, B. J., Herring, R. W., 1983

机译：数字VLsI中的雷达信号处理架构和算法（超大规模集成）

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